简单组合逻辑电路的设计实验报告(4)

清华大学电子技术实验——数电实验2——简单组合逻辑电路的设计

尽量要接入一固定的逻辑电平，尤其是使能端。而对于CMOS电路，（如74HC系列及4000系列）输入端不能悬空；

（3） 接插电路时要认真检查，不要有短路和漏接，尤其要注意电源

线和地线不要漏接；

（4） 要学会用万用表查错，首先要检查电源和地（集成电路管脚

处），如当一个与非门的输入信号正确，而输出不对时，在电源和地线都正确的前提下，若输出为低电平，就要检查集成电路输入管脚是否有信号，因为这经常是由于输入端开路（接线接触不良）引起的，此时输入管脚直流电压值为约1.2V；若输出为高电平，往往是由于输入端误接地引起的。如果输入及输出电压同时为2V左右的直流电压，有可能是因为输入端和输出端短路引起的；

六、 实验数据记录及处理

以下所示实验均使用Multisim10进行了仿真。在仿真时使用了单刀双掷开关分别将两端介入Vcc和GND，等效成电平开关。数码管使用了与试验箱上相同的4输入译码的数码管。 1、全加运算电路：

用数码管显示计算结果。要求显示出（1~3）+（1~3）结果； 电路设计：

首先设计一位全加器：

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